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Minimizing FPGA interconnect delays

Minimizing FPGA interconnect delays

Brown, S.; Khellah, M.; Vranesic, N.
  • 期刊名称IEEE Design & Test of Computers
  • 作者Brown, S.; Khellah, M.; Vranesic, N.
  • 卷第13卷
  • 期第4期
  • 印刷ISSN0740-7475
  • 文件大小1158.80KB
  • 发表时间1996-24
  • DOI10.1109/54.544532
  • 页码16-23
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